译码器 资源专区

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7段数码管译码器VHDL设计与FPGA2000显示实现

7段数码管译码器,用VHDL在FPGA2000上显示-7 LED decoder with VHDL shown in FPGA2000

VHDL FPGA 数码管

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Viterbi译码器VHDL源码及测试程序资源说明

一个完整的viterbi编码程序，使用vhdl语言编写，还有测试程序-A complete viterbi coding procedures, the use of VHDL l

Viterbi VHDL 通信系统

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OFDM卷积码译码器CC码源代码

OFDM下卷积码译码器CC码的源代码，欢迎大家下载参考！-OFDM convolutional codes under the CC decoder source code, we

OFDM 卷积码 译码器

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VHDL 3-8译码器模块功能与实例化说明

vhdl的3-8译码器-instantiate the 3-8 decoder

VHDL 数字电路 译码器

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七段数码显示译码器

7段数码显示译码器-seven of the digital display decoder

数字电路 译码器 七段数码管

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RS(255,223)码译码器FPGA实现与CSCC标准应用说明

CSCC标准下的RS(255,223)码的译码器设计，采用verilog语言编程实现，在软件QUARTUS II 9.0环境下仿真通过，并在CYCLONE IV系列开发板调试通过。

RS码 FPGA Verilog

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Verilog译码器与编码器电路实例资源说明

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Verilog 数字电路 译码器

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BCH码二进制FEC译码器

应用背景BCH码是一种流行的用于存储和传输系统中使用的纠错码。它增加了一些冗余检查数据到原始数据帧，冗余数据长度取决于校正能力，和所有计算进行在伽罗华域，适用于FPGA。关键技术编

BCH码 FEC 纠错码

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译码器在接口电路中的应用与设计

译码器在接口电路中的作用，学习带有译码器的接口电路设计方法-The decoder in the interface circuit in the role of learning

译码器 接口电路 地址译码

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Verilog 译码器文件

This a verilog file which is used as a decoder-This is a verilog file which is used as a d

Verilog 译码器 数字逻辑

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八位转七段译码器

译码器，将八位输出转换为七段译码显示，相当于7448驱动译码管-Decoder, the 8 output is converted to seven segment decodi

译码器 七段显示 7448

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VHDL译码程序

这是用VHDL编写的译码程序,程序简单易懂-VHDL prepared decoding procedures that are simple to understand

VHDL 译码器 数字逻辑

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