时序仿真资源专区

本专区汇聚了各类基于时序仿真开发的源码资源，共计 4 篇资源供开发者免费下载学习。

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资源描述详细的阅读了AHB协议规范，采用Verilog硬件描述语言，按照协议要求设计主机与从机。时序仿真通过。在压缩包里附有该设计的验证程序。

AHB Verilog 总线设计

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利用LMP的20bit counter,比自带的cout进位要快的多。已经同错综合和时序仿真。-LMP

计数器 LMP 高速

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四位数字乘法器，在quartus8.0下仿真时序图 -mult4

四位乘法器 Quartus 时序仿真

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定时仿真的matlab代码,适合常规信号-Timing simulation matlab code, suitable for conventional signals

MATLAB 时序仿真常规信号

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