Modelsim 资源专区

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ISE中文教程：VHDL与原理图设计输入及Modelsim仿真

是ISE的中文教程，主要是对初学者演示和展示在XILINX的ISE集成软件环境下，如何用VHDL和原理图的方式进行设计输入，用MOdelsim方针。-ISE is a Chines

ISE VHDL Modelsim

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电子密码锁开发与ModelSim仿真资源说明

本文是自已写的电子密码锁的详细开发过程，用的是Modelsim进行仿真实现，打开文档lzp-This article is written in their own electro

电子密码锁 数字电路 ModelSim

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基于FPGA的以太网MAC层Verilog实现

实现以太网mac层帧设计，在modelsim上可以直接仿真实现，对于以太网和FPGA的学习有很大的帮助。同时对于以太网的帧格式的设计方面的学习 帮助也非常的大。 

FPGA 以太网 MAC层

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HDL Bencher测试积累生成与ModelSim仿真指南

学习使用HDL Bencher生成测试积累，并直接调用ModelSim进行仿真的方法.-learning HDL Bencher generate test accumulatio

HDLBencher ModelSim 数字电路仿真

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异步时钟域通信模块设计与Modelsim仿真

设计了一个异步时钟域间进行通行的模块，并采用Modelsim进行仿真验证，仿真结果满足预期的目的。-Designed an asynchronous clock domains b

异步时钟 时钟域交叉 Modelsim

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基于 ModelSim6 的简单编码程序

A program for a simple encoder using ModelSim6

编码器 ModelSim 数字逻辑

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Modelsim交织模块设计

为了增强BAN系统的抗突发能力和提高系统可靠性，应对经过扩频后的数据进行交织。交织器本质上并不改变信息的内容而是改变信息的结构，是把信道传输过程中产生的集中错误最大限度的离散化

Modelsim 交织模块 BAN系统

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Modelsim数据导出方法

modelsim导出数据方法。即在verilog里面假如相应的代码。这样可以在使用modelsim进行仿真时，取出数据，看波形。

Modelsim Verilog 数据导出

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Modelsim PLI 使用示例：Verilog 与 C 语言联合仿真

用count.v和count.c两个文件作为例子，用来说明modelsim的pLI使用方法-using two source files (count.v and count.c

Modelsim PLI Verilog

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ModelSim仿真优化技术

To increase simulation speed, ModelSim® can apply a variety of optimizations to your desig

ModelSim 仿真优化 数字电路

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ModelSim仿真库添加指南

文章论述如何将向modelsim中添加仿真库，包括添加xilinx,altera,actel公司的仿真库的方法-Article on how to add ModelSim sim

ModelSim 仿真库 Xilinx

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基于VHDL的累加型模拟CPU设计与仿真

MODELSIM开发的模拟CPU，用VHDL语言描述，采用累加结构-ModelSim simulation developed CPU, using VHDL language d

VHDL CPU ModelSim

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