FPGA 资源专区

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基于Verilog的串口通信发射与汉明编码系统源码

利用Verilog语言实现串口通信发射模块，此项目程序可运行在quartus软件上。项目中包括波特率时钟模块、数据产生及汉明编码模块、串口发射模块。

Verilog FPGA 串口通信

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FPGA驱动TFT液晶屏控制器源码说明

资源描述使用FPGA控制TFT液晶屏，采用Verilog编写FSM控制TFT，控制流程包括TFT的初始化、清屏、显示图片。最主要的是要根据TFT的specification，写好初

FPGA TFT液晶 Verilog

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运动员反应时间测量电路设计说明

利用verilog编码，设计运动员反应测试时间的电路，共有三个输入，枪声、运动员和复位信号，另外，认为反应时间不可能小于200ms，因此当测量时间小于200ms时 会发出警报

Verilog 数字电路 反应时间

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基于VHDL的16位海明编码纠错与检测系统源码

应用背景这是16位海明码纠错和检测 ；16点，它是基于sechaming代码 ；这是实行在VHDL  ； ；关键技术VHDL语言代码 ； ；和Xilinx工具是用来实现它是合成的代

海明码 VHDL 纠错编码

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基于Xilinx FPGA的DDR2存储控制器设计与实现方案

基于Xilinx fpga的ddr2 控制器设计方法-Xilinx fpga-based controller design method of ddr2

Xilinx FPGA DDR2控制器

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基于VHDL的温度采集与数码管显示系统设计源码

vhdl学习基本编写程序，关于温度的读取和显示，vhdl学习基本编写程序，关于温度的读取和显示，vhdl学习基本编写程序，关于温度的读取和显示

VHDL FPGA 温度传感器

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基于VHDL的自动售货机系统

基于VHDL开发的自动售货机系统，可实现自动售货过程中的基本功能，具有一定的代表性。-VHDL-based development of a vending machine sys

VHDL 自动售货机 数字逻辑

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基于降低残留素数的FPGA AES-128 S盒实现

应用背景在本文中，我们提出了一种新的FPGAAES的S盒的利用高性能的实现减少素数的残留。这个该设计在Xilinx Virtex-5实现xc5vlx50 FPGA器件。目的是使用一

FPGA AES-128 S盒

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基于Virtex-5 FPGA的高效AES加密算法硬件实现

应用背景在本文中，一个高性能和高度优化Rijndael AES算法的硬件实现了设计并实现Xilinx Virtex-5 xc5vlx50FPGA器件。设计采用模块化利用VHDL语言

FPGA AES 硬件加速

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Nios II 软处理器快速入门指南

NIosII软处理器快速入门 让初学者快速熟悉nios ii 的软核处理-NIosII soft processors Quick Start for beginners quic

Nios II 软处理器 FPGA

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高吞吐量FPGA AES-128加解密实现方案

应用背景在本文中，我们提出了一种高效的非流水线式AES-128实现高实施吞吐量，以便它可以使用在千兆协议。我们实现我们的AES-128加密设计在Xilinx Virtex-7 FP

FPGA AES 加密

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基于Karatsuba算法的FPGA高性能AES-GCM流水线乘法器源码说明

应用背景在本文中，我们提出了流水线的吞吐量的AES-GCMkaratsuab人基于有限域乘法器。与我们提出的四级子二次有限域乘法器，Ghash功能不在GCM任何瓶颈硬件系统，无论三

AES-GCM FPGA Karatsuba算法

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