Verilog 资源专区

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OpenSPARC CCX Verilog 源代码

ccx的verilog代码,opensparc 的源代码-verilog of ccx

OpenSPARC Verilog CCX

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基于延时锁相环的FPGA时钟故障与毛刺检测电路设计工程

采用延时锁相环设计时钟延时电路，然后通过比较时钟信号来判断时钟信号是否发生时毛刺。压缩文件是一个VIVADO2015.1写的工程，包括测试文件，verilog语言编写

时钟检测 延时锁相环 Verilog

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32位Booth乘法器Verilog源代码

源文件中的代码是基于BOOTH2算法的32位乘法器，并且采用了4:2压缩器，并且进行了实际的仿真，直接运行就可以通过，代码通俗易懂，具有很好的参考意义，可以供初学者使用和参考。欢迎

Verilog Booth乘法器 32位

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北航Verilog数字系统设计教程

Verilog数字系统设计教程 北航的，不错!-Verilog Digital System Design Tutorial BUAA, and good!

Verilog 数字系统设计 硬件描述语言

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基于FPGA的四路OV7670摄像头图像采集与VGA显示系统

应用背景应用于多路图像并行采集和显示的场合。关键技术基于华升FPGA图像处理开发板完成了四路图像采集，并送VGA分屏显示，程序全部为Verilog硬件语言编写，摄像头采用OV767

FPGA 图像采集 VGA显示

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基于Verilog的同步模8计数器设计资源

Verilog实现的同步模8计数器,含有.v代码,数字电路线网图以及下板照片

Verilog 同步计数器 数字电路

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基于Verilog的AD9280测试与数据采集系统

通过verilog编写AD9280的测试程序，将AD9280采集的数据存储到sdram中，然后读取sdram中的数据，发送到串口进行保存。

Verilog AD9280 SDRAM

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基于Cyclone IV FPGA的AD9226高速数据采集与串口电压显示系统

测试AD9226采集数据能力，并将数据发送到串口显示为电压值.采用的是cyclone iv的FPGA。

FPGA AD9226 Verilog

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FPGA全数字锁相环ADPLL程序

应用背景ADPLL数字锁相环在fpga上工程中有广泛的应用，程序有verilog语言编写关键技术全数字锁相环ADPLL由verilog HDL语言编写在FPGA上使用。

FPGA ADPLL Verilog

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维特比译码器Verilog代码生成器

这是维特比译码器 verilog 代码生成器进行测试和 FPGA 验证。

维特比译码器 Verilog FPGA

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IIC从机硬件代码（FPGA验证）

IIC_slave硬件的代码，已经经过FPGA验证-IIC_slave hardware code, and has been verified through FPGA

IIC 从机 Verilog

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Verilog HDL程序设计教程

Verilog HDL程序设计教程，非常实用，对学习Verilog非常有用。

Verilog HDL 数字电路设计

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